数字电路设计完全手册

第1章 数制与逻辑代数

1.1 数制系统

1.1.1 十进制

1.1.2 二进制

1.1.3 八进制和十六进制

1.2 不同数制间的转换

1.2.1 十进制到非十进制的转换

1.2.2 非十进制到十进制的转换

1.2.3 二进制、八进制和十六进制之间的转换

1.3 二进制编码

1.3.1 二—十进制编码

1.3.2 格雷码

1.4 算术运算

1.5 数的表示

1.5.1 原码

1.5.2 反码

1.5.3 补码

第2章 布尔开关代数和逻辑原理

2.1 基本逻辑运算

2.2 逻辑代数的基本定理及规则

.2.2.1 逻辑函数表示

2.2.2 逻辑代数的基本公理

2.2.3 逻辑代数的基本定律

2.2.4 逻辑代数的基本规则

2.2.5 逻辑运算中的常用公式

2.3 逻辑函数表达式的形式

2.3.1 逻辑函数表达式的一般形式

2.3.2 标准积之和式（最小项之和式）

2.3.3 标准和之积式（最大项之积式）

2.3.4 不完全确定电路的sop和pos式表达

2.4 逻辑函数的代数化简法

2.4.1 常用的化简方法

2.4.2 或与式的化简

2.5 逻辑函数的卡诺图化简

2.5.1 卡诺图的构成

2.5.2 二变量和三变量卡诺图

2.5.3 四变量与四变量以上的卡诺图

2.5.4 逻辑函数与卡诺图的关系

2.5.5 卡诺图的特性

2.5.6 用卡诺图求逻辑函数最简“与或”式

2.5.7 包含无关项的函数化简

2.6 逻辑函数简化中的实际问题

2.6.1 多输出端电路

2.6.2 只有原变量输入的逻辑电路的简化

第3章 组合逻辑电路的分析与设计

3.1 逻辑电路设计标准

3.2 组合逻辑电路的基本概念

3.2.1 正负逻辑概念

3.2.2 完备集概念

3.3 组合电路的分析

3.3.1 组合电路的分析步骤

3.3.2 组合电路分析举例

3.4 组合逻辑的设计方法

3.5 多输出函数组合电路的设计

3.6 常用集成组合电路

3.6.1 编码器及其应用

3.6.2 译码器及其应用

3.6.3 数据选择器和数据分配器

3.6.4 数值比较器

3.6.5 奇偶检验产品器

3.6.6 算术电路

3.7 组合逻辑电路中的竞争冒险

3.7.1 产生竞争冒险的原因

3.7.2 竞争冒险的判别

3.7.3 消除竞争冒险的方法

第4章 触发器

4.1 基本rs触发器

4.2 sr锁存器

4.3 钟控rs触发器

4.4 d锁存器

4.5 边沿触发d触发器

4.6 主从rs触发器

4.7 主从jk触发器

4.8 边沿触发jk触发器

4.9 t触发器

第5章 时序电路的分析与设计

5.1 时序电路的一般概念

5.1.1 时序电路的特点

5.1.2 时序电路的分类

5.1.3 时序电路的描述方法

5.2 同步时序电路的分析

5.2.1 同步时序电路分析步骤

5.2.2 时序电路分析举例

5.3 同步时序电路的设计

5.3.1 原始状态转换图或状态转换表的形成

5.3.2 状态转化

5.3.3 状态分配

5.3.4 确定触发器，激励函数和输出函数

5.3.5 确定逻辑电路图

5.4 同步时序电路设计举例

5.5 异步时序电路分析

5.5.1 脉冲异步时序电路分析

5.5.2 电平异步时序电路分析

5.5.3 脉冲异步时序电路设计

5.5.4 电平异步时序电路设计

第6章 时序集成电路

6.1 寄存器及其应用

6.1.1 基本寄存器

6.1.2 并行寄存器

6.1.3 移位寄存器

6.2 计数器及其应用

6.2.1 异步二进制计数器

6.2.2 同步二进制计数器

6.2.3 触发器构成模n计数器

6.2.4 集成计数器及其应用

6.3 时序模块的应用

6.3.1 信号发生器

6.3.2 节拍分配器

6.3.3 并行数据——串行传输

6.3.4 程序分频器的实现

6.3.5 可编程序列产生器

第7章 可编程逻辑器件

7.1 专用集成电路

7.1.1 可编程逻辑器件

7.1.2 可编程只读存储器和可编程逻辑阵列

7.1.3 可编程阵列逻辑

7.1.4 通用阵列逻辑

7.2 现场可编程门阵列/复杂可编程逻辑器件概述

7.3 pld/fpga结构与原理

7.3.1 基于乘积项的pld结构

7.3.2 查找表的原理与结构

7.4 altera产品简介

7.4.1 altera pld的优点

7.4.2 altera系列芯片

7.5 altera的max7000系列器件介绍

7.5.1 max概述

7.5.2 max7000的功能描述

7.5.3 max7000可编程速度/功率控制

7.5.4 max7000输出配置

7.5.5 max7000器件编程

7.5.6 max7000边界扫描

7.5.7 max7000设计加密

7.5.8 max7000一般性测试

7.5.9 max7000的qfp运载架和开发插座

7.6 fpga设计中毛刺的问题

7.6.1 基本概念

7.6.2 fpga中的冒险现象

7.6.3 如何处理毛刺

7.7 数字系统的时钟

第8章 硬件描述语言verilog hdl

8.1 verilog hdl简介

8.2 verilog hdl特性

8.2.1 程序模块

8.2.2 延时

8.2.3 几种描述方式

8.2.4 设计描述的模拟

8.3 verilog hdl基本语法要素

8.4 verilog hdl的表达式

8.5 实例

8.5.1 计数器

8.5.2 锁存器

8.5.3 寄存器

8.5.4 双向总线

8.5.5 元件例化与层次设计

8.5.6 简单的状态机

8.5.7 加法器程序及相应的测试向量

第9章 max plus ii快速入门

9.1 max plus ii的安装

9.2 设计输入

9.2.1 图形设计输入

9.2.2 文本设计输入

9.2.3 创建顶层文件和层次显示

9.3 项目编译

9.4 模拟仿真

9.5 定时分析

9.6 器件编程

9.7 具体实例

9.8 dds系统设计

附录1 dds系统原程序

附录2 部分常用元器件符号对照表